使用verilog实现流水灯

该代码展示了如何用Verilog语言设计一个简单的流水灯控制器。模块名为TrafficLight，它有输入时钟clk、复位reset以及输出green和red。内部包含一个27位的计数器，当计数器值小于13进制的1000_0000时，表示绿色灯亮，否则红色灯亮。

下面是使用 Verilog 实现流水灯的简单示例代码：

module TrafficLight(input clk, input reset, output reg green, output red);

reg [26:0] counter;

always @(posedge clk)
begin
    if (reset)
        counter <= 0;
    else
        counter <= counter + 1;
end

always @(posedge clk)
begin
    if (counter < 13'b1000_0000